Національний університет "Львівська політехніка"
Кафедра ЕОМ
Звіт
про виконання лабораторної роботи №2
з курсу "Проектуванння периферійних комп’ютерних мікросистем"
на тему: “ Розробка на структурному рівні”
Мета роботи: створення і перевірка структурних VHDL-описів кристалу та зовнішніх корпусних контактних майданчиків.
Теоретична частина:
На цьому етапі переходять від функціонального опису кристалу до структурного. Тут кристал розбивається на два конструктиви:
1). Безпосередньо схема кристалу (core).
2). Зовнішні корпусні контактні майданчики (pads).
Структурний рівень передбачає опис цих двох конструктивів мовою структурного опису VHDL.
Відмінність структурного опису VHDL від функціонального полягає в тому, що в структурному описі оперують реальними бібліотечними елементами кристалу.
Створити структурний опис, який за обсягом на кілька порядків більший за функціональний, важко. Тому пакет Alliance передбачає два незалежних способи автоматизоавного отримання структурного опису для core та pads:
1) За допомогою текстового редактора створюється файл мовою С. Цей файл є проміжним форматом для створення структурного опису. У ньому за допомогою викликів спеціальних функцій формується виборка необхідних елементів з бібліотеки кристалу. Далі програмою-компілятором GENLIB проміжний С-файл переводять у необхідний структурний опис. У системі Alliance цей спосіб є рекомендованим.
2) Другий спосіб не вимагає додаткового набору інформації. Достатньо скористатись програмою-генератором LOGIC, на вхід якої задають функціональний VHDL-опис, а на виході отримують структурний VHDL-опис. Виборка бібліотечних елементів кристалу відбувається автоматично.
Після отримання структурних описів для core та pads, виконується симуляція на структурному рівні. Користуючись симулятором ASIMUT, перевіряють роботу тестових наборів на структурній VHDL-моделі безпосередньо схеми кристалу core. При виникненні помилки слід повернутись на попередні рівні. Симуляція для структурного опису зовнішніх корпусних контактних майданчиків pads не потрібна, оскільки цей опис не містить логічних перетворень сигналів.
Тексти проміжних описів на мові С:
# ,,,,,
# (o o)
####=====oOO--(_)--OOO=====####
# core.с
#include <genlib.h>
main()
{
DEF_LOFIG("core");
LOCON("a[3:0]", IN, "a[3:0]"); /* input bus a */
LOCON("b[3:0]", IN, "b[3:0]"); /* input bus b */
LOCON("e", OUT, "e"); /* output wire */
LOCON("vdd", IN, "vdd" ); /* power supply */
LOCON("vss", IN, "vss" ); /* ground */
for (int i = 0; i < 4; i++)
{LOINS("xr2_y", NAME("xr%d",i),NAME("a[%d]",i),NAME("b[%d]",i),NAME("int[%d]",i),"vdd","vss",0);}
LOINS("o3_y", "or1", "int[0]", "int[1]", "int[2]", "int[4]", "vdd", "vss", 0);
LOINS("o2_y", "or2", "int[3]", "int[4]", "int[5]", "vdd", "vss", 0);
LOINS("n1_y", "n10", "int[5]", "e", "vdd", "vss", 0);
SAVE_LOFIG();
exit(0);
}
# ,,,,,
# (o o)
####=====oOO--(_)--OOO=====####
# cmp4.с
#include <genlib.h>
main()
{int i;
DEF_LOFIG("cmp4");
LOCON("a[3:0]", IN, "a[3:0]"); /* input bus a */
LOCON("b[3:0]", IN, "b[3:0]"); /* input bus b */
LOCON("vdd", IN, "vdd" ); /* core power supply */
LOCON("vss", IN, "vss" ); /* core ground */
LOCON("vdde", IN, "vdde" ); /* pads power supply */
LOCON("vsse", IN, "vsse" ); /* pads ground */
LOCON("e", OUT, "e"); /* output */
LOINS ("pvsse_sp", "p9", "cki", "vdde", "vdd", "vsse", "vss", 0);
LOINS ("pvsse_sp", "p10", "cki", "vdde", "vdd", "vsse", "vss", 0);
LOINS ("pvdde_sp", "p11", "cki", "vdde", "vdd", "vsse", "vss", 0);
LOINS ("pvssi_sp", "p12", "cki", "vdde", "vdd", "vsse", "vss", 0);
LOINS ("pvddi_sp", "p13", "cki", "vdde", "vdd", "vsse", "vss", 0);
for (i = 0; i < 4; i++)
LOINS("pi_sp",NAME("p%d",i),...
